Cortex ‐ M3在核心水平上搭載了一顆中斷控制器——嵌套向量中斷控制器NVIC(Nested Vectored
Interrupt Controller)。它與核心有很深的“私交”——與核心是緊耦合的。NVIC 提供如下的功能:
z 可嵌套中斷支持
z 向量中斷支持
z 動態優先權調整支持
z 中斷延遲大大縮短
z 中斷可禁止
提供中斷控制器,用於總體管理異常,稱之為“內嵌向量中斷控制器:Nested Vectored Interrupt Controller (NVIC)”。NVIC和處理器核心緊密相連. 它提供以下特徵。 支持嵌套和向量中斷 自動保存和恢復處理器狀態 動態改變優先權 簡化的和確定的中斷時間 NVIC 依照優先權處理所有支持的異常,所有異常在“處理器模式”處理。NVIC 結構支持32(IRQ[31:0]) 個離散中斷,每箇中斷可以支持 4 級離散中斷優先權。所有的中斷和大多數系統異常可以配置為不同優先權。當中斷髮生時,NVIC 將比較新中斷與當前中斷的優先權,如果新中斷優先權高,則立即處理新中斷。當接受任何中斷時,ISR的開始地址可從記憶體的向量表中取得。不需要確定哪箇中斷被回響,也不要軟體分配相關中斷服務程式(ISR)的開始地址。當獲取中斷入口地址時,NVIC 將自動保存處理狀態到棧中,包括以下暫存器“PC, PSR, LR, R0~R3, R12” 的值。在ISR結束時,NVIC 將從棧中恢復相關暫存器的值,進行正常操作,因此花費少量且確定的時間處理中斷請求。NVIC 支持末尾連鎖 ”TailChaining”,有效處理背對背中斷 ”back-to-back interrupts”,即無需保存和恢復當前狀態從而減少在切換當前ISR時的延遲時間。NVIC 還支持遲到 “Late Arrival”,改善同時發生的ISR的效率。當較高優先權中斷請求發生在當前ISR開始執行之前(保持處理器狀態和獲取起始地址階段),NVIC 將立即處理更高優先權的中斷,從而提高了實時性。
Cortex ‐ M3在核心水平上搭載了一顆中斷控制器——嵌套向量中斷控制器NVIC(Nested Vectored
Interrupt Controller)。它與核心有很深的“私交”——與核心是緊耦合的。NVIC 提供如下的功能:
z 可嵌套中斷支持
z 向量中斷支持
z 動態優先權調整支持
z 中斷延遲大大縮短
z 中斷可禁止
《ARM Cortex-M0與Cortex-M0+權威指南(第2版)》是2018年清華大學出版社出版的書籍,作者是Jsoseph Yiu,吳常玉 張淑 吳衛東。
內容簡介 目錄中斷控制器(NVIC)3.6.1靈活的中斷管理3.6.2支持嵌套...
內容簡介 作者簡介 圖書目錄,Cortex-M3首次在核心上集成了嵌套向量中斷控制器(NVIC...8章有詳述)。 NVIC支持對每一路中斷設定不同的優先權,使得中斷管理...
概述 核心架構 特點 產品概述 編程模式NVIC。沒有讀/寫FIFO,除PCCARD之外,代碼都是從外部存儲器...是72MHz時,外部訪問按照36MHz進行。4、嵌套矢量中斷控制器(NVIC...),提供16箇中斷優先權。緊密耦合的NVIC實現了更低的中斷處理延遲,直接向...
產品介紹 歷史 STM32F1 互聯型 新系列fault 7.6 SVC和Pend SV 第8章 NVIC與中斷控制 8.1 NVIC概覽 8.2 中斷配置基礎 8.3 中斷的使能與除能...參考 附錄D NVIC暫存器小結 附錄E Cortex-M3疑難解答...
內容簡介 作者簡介 圖書目錄圖書信息作者:薛園園 (作者) 出版社: 電子工業出版社; 第1版 (2011年9月1日) 叢書名: 21天學編程...
圖書信息 內容簡介 目錄內容簡介本書言簡意賅、通俗易懂,知識點覆蓋全面,詳細講述了最新的ARM Cortex-M3核心及STM32處理器編程,使讀者能夠...
內容簡介 前 言 目 錄13015.1 異常類型 13015.2 NVIC簡介 13115.2.1 NVIC暫存器簡介 13115.2.2 NVIC中斷配置固件庫 13215.3...
內容簡介 作者簡介 圖書目錄技術架構Cortex—M0屬於ARMv6-M架構,包括1顆專為嵌入式套用而設計的ARM核、緊耦合的可嵌套中斷微控制器NVIC、可選的喚醒中斷...的邏輯門數也降低了待機電流。而高效的中斷控制器(NVIC)需要很小的中斷...
技術架構 特點 套用領域